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<loop_index id="5fa9784008db5">Register|Aufbau, Register|Arbeitsweise, Register|Register, Aufbau|Register, Arbeitsweise</loop_index>Register sind gemäß ihrer Definition kleine <loop_index id="5fa9784008dc2">Speichereinheit, Register</loop_index>Speichereinheiten, die sich direkt auf der CPU befinden. Den internen Aufbau und die Arbeitsweise eines <loop_index id="5fa9784008dcc">8-Bit-Register|Register, 8-Bit</loop_index>8-Bit-Registers erläutert das folgende Video. | <loop_index id="5fa9784008db5">Register|Aufbau, Register|Arbeitsweise, Register|Register, Aufbau|Register, Arbeitsweise</loop_index>Register sind gemäß ihrer Definition kleine <loop_index id="5fa9784008dc2">Speichereinheit, Register</loop_index>Speichereinheiten, die sich direkt auf der CPU befinden. Den internen Aufbau und die Arbeitsweise eines <loop_index id="5fa9784008dcc">8-Bit-Register|Register, 8-Bit</loop_index>8-Bit-Registers erläutert das folgende Video. | ||
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<loop_figure title="Wahrheitstafeln von UND-Gattern mit zwei bzw. drei Eingängen" description="" copyright="CC-BY" index=true show_copyright=true id=" | <loop_figure title="Wahrheitstafeln von UND-Gattern mit zwei bzw. drei Eingängen" description="" copyright="CC-BY" index=true show_copyright=true id="5ff1a873177ab">[[Datei:Wahrheitstafel UND-Gatter.jpg|617px]]</loop_figure> | ||
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Auch das Verhalten des RS-Flip-Flop lässt sich mit einer Wahrheitstafel beschreiben: | |||
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<loop_figure title="RS-Flip-Flop und die zugehörige Wahrheitstafel" description="" copyright="CC-BY" index=true show_copyright=true id="5ff1a63f2c170">[[Datei:RS-FlipFlop mit WT.jpg|639px]]</loop_figure> | |||
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== Aufgabe 1 == | == Aufgabe 1 == | ||
<p id="Aufgabe 1: Flip-Flop I"> | <p id="Aufgabe 1: Flip-Flop I"> | ||
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<loop_task title="Simulationsframework Hades" id="5fa9784008e9f"> | <loop_task title="Simulationsframework Hades" id="5fa9784008e9f"> | ||
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Norman Hendrich von der Universität Hamburg hat mit [http://tams-www.informatik.uni-hamburg.de/applets/hades/webdemos/index.html Hades]<loop_index id="5fa9784008ea8">Hades|Hades Framework|Hades Simulationsframework</loop_index> ein <loop_index id="5fa9784008eb1">Simulationsframework Hades|Framework Hades</loop_index>Simulationsframework bereitgestellt, welches u.a. den internen Aufbau und die <loop_index id="5fa9784008eba">Arbeitsweise, RS-Flip-Flop | Norman Hendrich von der Universität Hamburg hat mit [http://tams-www.informatik.uni-hamburg.de/applets/hades/webdemos/index.html Hades]<loop_index id="5fa9784008ea8">Hades|Hades Framework|Hades Simulationsframework</loop_index> ein <loop_index id="5fa9784008eb1">Simulationsframework Hades|Framework Hades</loop_index>Simulationsframework bereitgestellt, welches u.a. den internen Aufbau und die <loop_index id="5fa9784008eba">Arbeitsweise, RS-Flip-Flop</loop_index><loop_index id="5fa978988e143">Flip-Flop, Arbeitsweise</loop_index><loop_index id="5fa978988e14f">RS-Flip-Flop, Arbeitsweise</loop_index>Arbeitsweise eines RS-Flip-Flops per Applet im Browser veranschaulicht. Probiere es aus unter: | ||
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<p><small>Diese Seite war zuletzt nicht mehr direkt erreichbar. Allerdings existiert noch eine statische Kopie beim Internet Archive (ohne Applets, aber mit Wahrheitstafeln): https://web.archive.org/web/20110830134111/http://tams-www.informatik.uni-hamburg.de/applets/hades/webdemos/16-flipflops/10-srff/srff.html</small> | |||
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Register sind gemäß ihrer Definition kleine Speichereinheiten, die sich direkt auf der CPU befinden. Den internen Aufbau und die Arbeitsweise eines 8-Bit-Registers erläutert das folgende Video.
Wenn Sie dieses Element öffnen, werden Inhalte von externen Dienstleistern geladen und dadurch Ihre IP-Adresse an diese übertragen.
Ein Register besteht aus einzelnen Speicherzellen. Jede Speicherzelle kann dabei den Wert von genau einem Bit aufnehmen. Ein Register der Breite acht besitzt demnach acht Speicherzellen.
Jede Speicherzelle verfügt über eine separate Input- sowie Output-Leitung. Die Select- und Write-Leitung steht einmal für alle Speicherzellen zur Verfügung.
Der interne Aufbau einer einzelnen Speicherzelle sieht wie folgt aus:
Die Speicherzelle besteht aus einem sogenannten RS-Flip-Flop, drei UND-Gattern, einem NICHT-Gatter sowie der notwendigen Verdrahtung.
Das folgende Video erklärt die Arbeitsweise der Speicherzelle:
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Hier folgen die im Video gezeigten Wahrheitstafeln der UND-Gatter:
Neben dem hier gezeigten UND-Gatter gibt es noch eine Reihe weiterer Gatter. Diese werden treffenderweise im Kapitel Gatter beschrieben.
Auch das Verhalten des RS-Flip-Flop lässt sich mit einer Wahrheitstafel beschreiben:
Im RS-Flip-Flop ist der Wert Null gespeichert. Die Eingangsleitungen besitzen folgende Werte:
Welcher Wert wird unter diesen Voraussetzungen für den Ausgang (Output) der Speicherzelle ermittelt?
Im RS-Flip-Flop ist der Wert Eins gespeichert. Die Eingangsleitungen besitzen folgende Werte:
Welcher Wert wird unter diesen Voraussetzungen für den Ausgang (Output) der Speicherzelle ermittelt?
(Die Werte für Input, Select und Write sind identisch mit denen aus Aufgabe 1, jedoch unterscheidet sich der im Flip-Flop gespeicherte Wert!)
Welchen Wert gibt das RS-Flip-Flop am Ausgang Q aus, wenn beide Eingänge gleich Null sind (S=0, R=0)?
Norman Hendrich von der Universität Hamburg hat mit Hades ein Simulationsframework bereitgestellt, welches u.a. den internen Aufbau und die Arbeitsweise eines RS-Flip-Flops per Applet im Browser veranschaulicht. Probiere es aus unter:
http://tams-www.informatik.uni-hamburg.de/applets/hades/webdemos/16-flipflops/10-srff/srff.html
Du erkennst hier: Auch ein RS-Flip-Flop ist nichts anderes als eine digitale Schaltung bestehend aus einfachen Gattern.
Diese Seite war zuletzt nicht mehr direkt erreichbar. Allerdings existiert noch eine statische Kopie beim Internet Archive (ohne Applets, aber mit Wahrheitstafeln): https://web.archive.org/web/20110830134111/http://tams-www.informatik.uni-hamburg.de/applets/hades/webdemos/16-flipflops/10-srff/srff.html
In den im Applet auf der Hades-Seite aus der vorangegangenen Aufgabe angegebenen Wahrheitstafeln gibt es jeweils den Hinweis "forbidden".
Weiterführende Literatur
Die hier verlinkte Online-Ausgabe eines Lehrtextes der Otto-Friedrich-Universität Bamberg liefert in Kapitel 5.2 und 5.3 detailliertere Informationen zum Aufbau eines Registers und seiner Speicherzellen. In weiteren Kapiteln finden sich darüber hinaus ergänzende Erläuterungen zum Themengebiet. Die Lektüre dieser Quelle sei unter Beachtung der geltenden Lizenz ausdrücklich empfohlen.
Autoren: Martin Eisenhardt, Andreas Henrich, Stefanie Sieber
Rechner- und Betriebssysteme, Kommunikationssysteme, Verteilte Systeme
Dieses Werk steht unter der Creative Commons BY-NC-ND-Lizenz
http://creativecommons.org/licenses/by-nc-nd/2.0/de/